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采用CPLD增强单片机P89C669外部设备扩展能力

发布时间:2019-06-12 08:16 来源:未知 编辑:admin

  )内核的微处理器,其指令执行速度2倍于标准的80C51器件,线性地址经后可支持高达8 MB的程序存储器和8 MB的数据存储器,这是他相对于标准51内核的最大优点。

  目前的单片系统越来越复杂,扩展也更多,如果能充分利用P89C669的丰富的线性地址资源,将能大大增强系统能力。在一个嵌入式系统开发中,笔者采用ALTERA公司的CPLDCPLD芯片EPM7032利用这款单片机的线性地址扩展了丰富的资源。

  从表1可见,P89C669对传统的51内核的3部分存储结构进行了相应的扩展,各个部分的片内存储空间也增加了,如内部数据空间有1 280 B在片内,外部数据空间有768 B在片内,有96 kB的片内程序存储空间等。

  寻址指令除了传统的MOV,MOVX,MOVC外,EMOV指令与24位的通用指针寄存器EPTR可寻址16MB的全部空间,但是所占用的指令周期也较长。

  扩展外部数据存储空问HDATA除了768 B在片内外,其余地址空间可以用来扩展外部设备(其实只要把片内的768 B通过指令将其屏蔽,也可以用来扩展外部设备)。

  寻址8 MB的数据存储空间,需要有23 b的地址寻址能力,P89C669将传统51内核的P2高位地址时分复用,从而得到23 b地址寻址能力,时序图如图1所示,即当使用23 b地址时,ALE为高时,地址位A16~A22输出到P2.0~P2.6;ALE为低时,地址位A8~A14输出到P2.0~P2.6。无论ALE为何值,位地址A15都从P2.7输出。

  在某产品的控制系统中,扩展的外部设备比较丰富,利用P89c669的23 b地址寻址能力进行设备地址编码,所以需要对23 b地址的时序逻辑进行处理,处理单元交给一块ALTERA公司的CPLD(EPM7032)。

  在满足系统资源的前提下,选用EPM7032,将P89C669的P2口作为处理单元输入信号,经过CPLD的内部逻辑进行译码或数据锁存,以获得各个外部设备资源的选择信号及少量的控制信号,如图2所示。

  在本设计中,共需要得到设备选择信号如SRAM芯片M68AF127B的片选CS_RAM,2个FLASH ROM芯片SST29SF040的片选CS_ROM0,CS_ROM1,模拟多路选择器SN74LV4052的使能信号线,另外还有一些控制信号线,这里就不一一介绍。

  实际上,P2口引入CPLD,就P89C669的23 b地址线而言,用来地址译码和少量的控制信号等主要是利用最高的几位,在本设计中,由于SST29SF040用到地址线,所以CPLD的地址译码处理只能是利用剩下的A19~A22,这将在下文的CPLD的译码单元可以看到。

  A0~A7低地址采用74HC573进行锁存,A16~A18地址内容采用74HC574进行锁存,如图3所示。

  CPLD的设计采用原理图的方法进行设计,简便快捷,如图6所示,采用74374模块锁存P2口的输入信号,ALE反向后得到_ALE作为74374的锁存时钟线输入。

  如果不是对SST29SF040进行读写,则高位地址线仍然可以利用,这里将其作为74HC4052的3个输入控制线。

  编写设备驱动程序是在KeilC51的平台上,由于利用了P89C669的23 b地址线的平台上采用指针读写设备很方便,这里给出读写SRAM芯片M68AF127B的C源代码例子,以供参考。

  以上3句为测试SRAM的测试代码,START_EX-TRAM为SRAM芯片的起始地址(可根据CPLD的内部设计进行相应的修改),第2,3句分别是写、读数据的宏。

  利用P89C669的23 b的线性地址并采用CPLD扩展外部设备资源可以说是不错的一个方法,对外部设备的访问将显得更加简便,当然,在成本方面系统设计工程师也要加以考虑,并最终寻找一个性价比最高的方案。

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